Bitset

Установите заданный бит сохраненного целого числа одному

Библиотека:
Simulink / Логика и Битовые операции
HDL Coder / Логика и Битовые операции

Описание

Блок Bit Set устанавливает заданный бит сохраненного целого числа одному. Масштабирование проигнорировано.

Можно задать бит, который будет установлен в один с параметром Index of bit, где битный нуль является младшим значащим битом.

Порты

Входной параметр

развернуть все

`Port_1` — Входной сигнал
скаляр или вектор

Входной сигнал с заданным битом сохраненного целого числа.

Типы данных: single | double | Boolean | fixed point

Вывод

развернуть все

`Port_1` — Выходной сигнал
скаляр или вектор

Выходной сигнал с заданным набором битов к 1.

Параметры

развернуть все

`Index of bit` — Индекс бита
0 (значений по умолчанию) | скаляр или вектор

Индекс бита, где бит 0 является младшим значащим битом.

Программируемое использование

Параметры блоков: iBit

Ввод: символьный вектор

Значения: положительное целое число

Default:'0'

Образцовые примеры

Используя небольшой блок Set

Если блок Bit Set включен для бита, 2 бита 2 установлены в 1.

Скрипт Open Live Script

Характеристики блока

Типы данных	`^Boolean[a]`\| `fixed point` \| `integer`
Прямое сквозное соединение	`no`
Многомерные сигналы	`no`
Сигналы переменного размера	`no`
Обнаружение пересечения нулем	`no`
^[a] Битовые операции не рекомендуются для использования с булевыми сигналами.

Расширенные возможности

Генерация кода C/C++
Генерация кода C и C++ с помощью Simulink® Coder™.

Генерация HDL-кода
Сгенерируйте Verilog и код VHDL для FPGA и проекты ASIC с помощью HDL Coder™.

Для получения дополнительной информации о генерации HDL-кода, смотрите Набор битов.

Генерация кода PLC
Сгенерируйте код Структурированного текста с помощью Simulink® PLC Coder™.

Преобразование фиксированной точки
Преобразуйте алгоритмы с плавающей точкой в фиксированную точку с помощью Fixed-Point Designer™.

Представлено до R2006a

Поддержка

Памятка переводчика

1. Если смысл перевода понятен, то лучше оставьте как есть и не придирайтесь к словам, синонимам и тому подобному. О вкусах не спорим.

2. Не дополняйте перевод комментариями “от себя”. В исправлении не должно появляться дополнительных смыслов и комментариев, отсутствующих в оригинале. Такие правки не получится интегрировать в алгоритме автоматического перевода.

3. Сохраняйте структуру оригинального текста - например, не разбивайте одно предложение на два.

4. Не имеет смысла однотипное исправление перевода какого-то термина во всех предложениях. Исправляйте только в одном месте. Когда Вашу правку одобрят, это исправление будет алгоритмически распространено и на другие части документации.

5. По иным вопросам, например если надо исправить заблокированное для перевода слово, обратитесь к редакторам через форму технической поддержки.

Документация

Bitset

Описание

Порты

Входной параметр

`Port_1` — Входной сигнал
скаляр или вектор

Вывод

`Port_1` — Выходной сигнал
скаляр или вектор

Параметры

`Index of bit` — Индекс бита
0 (значений по умолчанию) | скаляр или вектор

Программируемое использование

Образцовые примеры

Используя небольшой блок Set

Характеристики блока

Расширенные возможности

Генерация кода C/C++
Генерация кода C и C++ с помощью Simulink® Coder™.

Генерация HDL-кода
Сгенерируйте Verilog и код VHDL для FPGA и проекты ASIC с помощью HDL Coder™.

Генерация кода PLC
Сгенерируйте код Структурированного текста с помощью Simulink® PLC Coder™.

Преобразование фиксированной точки
Преобразуйте алгоритмы с плавающей точкой в фиксированную точку с помощью Fixed-Point Designer™.

Смотрите также

Представлено до R2006a

Документация Simulink

Поддержка

Документация

Bitset

Описание

Порты

Входной параметр

Port_1 — Входной сигнал скаляр или вектор

Вывод

Port_1 — Выходной сигнал скаляр или вектор

Параметры

Index of bit — Индекс бита 0 (значений по умолчанию) | скаляр или вектор

Программируемое использование

Образцовые примеры

Используя небольшой блок Set

Характеристики блока

Расширенные возможности

Генерация кода C/C++ Генерация кода C и C++ с помощью Simulink® Coder™.

Генерация HDL-кода Сгенерируйте Verilog и код VHDL для FPGA и проекты ASIC с помощью HDL Coder™.

Генерация кода PLC Сгенерируйте код Структурированного текста с помощью Simulink® PLC Coder™.

Преобразование фиксированной точки Преобразуйте алгоритмы с плавающей точкой в фиксированную точку с помощью Fixed-Point Designer™.

Смотрите также

Представлено до R2006a

Документация Simulink

Поддержка

`Port_1` — Входной сигнал
скаляр или вектор

`Port_1` — Выходной сигнал
скаляр или вектор

`Index of bit` — Индекс бита
0 (значений по умолчанию) | скаляр или вектор

Генерация кода C/C++
Генерация кода C и C++ с помощью Simulink® Coder™.

Генерация HDL-кода
Сгенерируйте Verilog и код VHDL для FPGA и проекты ASIC с помощью HDL Coder™.

Генерация кода PLC
Сгенерируйте код Структурированного текста с помощью Simulink® PLC Coder™.

Преобразование фиксированной точки
Преобразуйте алгоритмы с плавающей точкой в фиксированную точку с помощью Fixed-Point Designer™.