Модулятор символа LTE

Модулируйте биты данных, чтобы объединить символы данных о LTE

Библиотека:
LTE HDL Toolbox / Модуляция

Описание

Блок-диаграммы Модулятора Символа LTE группа битов данных к символам комплексных данных при помощи типов модуляции поддержаны TS 36.211 [1] стандарта LTE. Блок обеспечивает архитектуру, подходящую для аппаратного развертывания и генерации HDL-кода. Можно использовать этот блок в разработке передатчика LTE.

Блок принимает 1-битный из данных за один раз, наряду с управляющими сигналами, и выводит модулируемый комплексный символ с допустимым сигналом. Каждый комплексный символ включает стандартное количество битов на основе типа модуляции, как показано в этой таблице. Если вы обеспечиваете ненесколько биты порядка модуляции как вход, блок игнорирует выходной символ с недостаточными или чрезмерными битами. Порядок модуляции является количеством битов на символ.

Тип модуляции	Порядок модуляции - количество битов на символ
BPSK	1
QPSK	2
16-QAM	4
64-QAM	6
256-QAM	8

Порты

Входной параметр

развернуть все

`данные` Биты входных данных
скаляр

Биты входных данных, заданные как скаляр. Блок принимает биты данных ufix1 или Boolean.

Типы данных: Boolean | fixdt(0,1,0)

`valid` — Укажите на допустимые входные данные
Булев скаляр

Управляющий сигнал, который указывает, допустимо ли входные данные. Когда этим значением является (TRUE) 1, блок принимает значения на входном порте data. Когда этим значением является (FALSE) 0, блок игнорирует значения на входном порте data.

Типы данных: Boolean

`modSel` — Выбор модуляции
целое число

Выберите тип модуляции путем определения его соответствующего значения, показанного в этой таблице.

Значения modSel от 0 до 4. Каждое значение представляет определенный тип модуляции.

Значение	Тип модуляции
0	BPSK
1	QPSK
2	16-QAM
3	64-QAM
4	256-QAM

Если вы задаете значение кроме одного перечисленного в этой таблице, блок отображает предупреждающее сообщение и:

Применяет модуляцию QPSK, когда load является (TRUE) 1.
Продолжает текущую модуляцию, когда load является (FALSE) 0.

Для генерации HDL-кода задайте это значение в формате fixdt(0,3,0).

Зависимости

Чтобы включить этот порт, установите параметр Modulation source на Input port.

Типы данных: fixdt(0,3,0) | double | single

`загрузка` Управление модуляцией
Булев скаляр

Управляющий сигнал выбрать модуляцию.

Когда этим значением является (TRUE) 1, блок применяет модуляцию на основе modSel значения. Когда этим значением является (FALSE) 0, блок игнорирует любые изменения в modSel значении и продолжает текущую модуляцию до изменений load в (TRUE) 1.

Если никакое начальное значение load не применяется, блок применяет модуляцию QPSK.

Зависимости

Чтобы включить этот порт, установите параметр Modulation source на Input port.

Типы данных: Boolean

Вывод

развернуть все

`данные` Модулируемые символы комплексных данных
скаляр

Модулируемые символы комплексных данных, возвращенные как скаляр.

Типы данных: single | double | fixdt(1,wordlength,wordlength-2)
Поддержка комплексного числа: Да

`valid` — Допустимая индикация выходных данных
Булев скаляр

Управляющий сигнал, который указывает, допустимы ли данные из выходного порта data. Когда этим значением является (TRUE) 1, блок возвращает допустимые данные по выходному порту data. Когда этим значением является (FALSE) 0, блок игнорирует значения на выходном порте data.

Типы данных: Boolean

Параметры

развернуть все

Основной

`Modulation source` — Источник для типа модуляции
`Property` (значение по умолчанию) | `Input port`

Чтобы задать тип модуляции при помощи параметра Modulation, выберите Property. Чтобы задать тип модуляции от порта modSel в течение времени выполнения, выберите Input port.

`Modulation` — Тип модуляции
`BPSK` (значение по умолчанию) | `QPSK` | `16-QAM` | `64-QAM` | `256-QAM`

Выберите тип модуляции.

Зависимости

Чтобы включить этот параметр, установите параметр Modulation source на Property.

Типы данных

`Output data type` — Выбор типа выходных данных
`double` (значение по умолчанию) | `single` | `Custom`

Задайте тип данных для выходных данных.

double и типы данных single поддерживаются для симуляции.

Для симуляции и генерации HDL-кода, установленной это значение к Custom.

`Word length` — Выведите размер слова
`16` (значение по умолчанию) | целое число в области значений [3, 32]

Задайте выходной размер слова. Это значение должно быть целым числом в области значений [3, 32].

Зависимости

Чтобы включить этот параметр, установите параметр Output data type на Custom.

Образцовые примеры

Модуляция символа LTE битов данных

Используйте блок LTE Symbol Modulator, чтобы модулировать биты данных к символам комплексных данных. Можно сгенерировать HDL-код от этого блока.

Открыть скрипт

Алгоритмы

развернуть все

Выведите формы волны

Эти данные показывают демонстрационные выходные параметры блока, когда управляется с фиксированным типом модуляции, примененным с помощью параметра Modulation и, когда управляется с отличавшимися типами модуляции, примененными с помощью входного порта modSel. Задержка блока равна сумме трех тактов и количеству битов на символ.

Блок получает выходные символы в допустимых циклах.

Эти данные показывают демонстрационный вывод, когда вы выбираете модуляцию BPSK при помощи параметра Modulation. В этом демонстрационном выводе задержка блока равняется 4.

Эти данные показывают демонстрационный вывод, когда вы выбираете BPSK, QPSK, 16-QAM, 64-QAM и модуляции 256-QAM при помощи входного порта modSel. Задержка блока меняется в зависимости от выбора модуляции.

Производительность

Эта таблица показывает результаты синтеза данных ресурсов и данных о производительности блока при использовании входного порта modSel как источник модуляции и выходной размер слова 16. Сгенерированный HDL предназначен на оценочную плату Xilinx^® Zynq^®-7000 ZC706. Проект достигает частоты часов 872 МГц.

Ресурс	Используемый номер
Срез LUTs	61
Регистры среза	67
DSP48	0

Ссылки

[1] 3GPP TS 36.211. "Физические каналы и модуляция". Проект Партнерства третьего поколения; Сеть радиодоступа Technical Specification Group; Развитый Универсальный Наземный Радио-доступ (к E-UTRA). URL: https://www.3gpp.org.

Расширенные возможности

Генерация кода C/C++
Генерация кода C и C++ с помощью Simulink® Coder™.

Этот блок поддерживает генерацию кода C/C++ для Акселератора Simulink^® и Быстрых Режимов Accelerator и для генерации компонента DPI.

Генерация HDL-кода
Сгенерируйте Verilog и код VHDL для FPGA и проекты ASIC с помощью HDL Coder™.

HDL Coder™ обеспечивает дополнительные параметры конфигурации, которые влияют на реализацию HDL и синтезируемую логику. Для получения дополнительной информации о реализациях свойства и ограничения для генерации HDL-кода, видят Модулятор Символа LTE в документации HDL Coder.

Смотрите также

lteSymbolModulate

Документация

Модулятор символа LTE

Описание