HDL Coder™ может сгенерировать ядро IP, интегрировать его в ваш проект Qsys и программировать оборудование Intel. Используя Embedded Coder®, можно сгенерировать и создать встроенное программное обеспечение и запустить его на процессоре ARM®. Смотрите Рабочий процесс Элемента кода аппаратного программного обеспечения для Платформ SoC.
Чтобы развернуть ваш проект на устройстве Intel SoC, необходимо установить Пакет Поддержки HDL Coder для Устройств Intel SoC. Дополнительные сведения см. в HDL Coder Поддерживаемые аппаратные средства.
hdlcoder.Board | Объект регистрации плат, который описывает SoC пользовательская плата |
hdlcoder.ReferenceDesign | Регистрационный объект исходного проекта, который описывает исходный проект SoC |
hdlcoder.WorkflowConfig | Сконфигурируйте рабочие процессы развертывания и генерация HDL-кода |
Образцовый проект для ведомой интерфейсной генерации AXI4
Как разработать вашу модель для AXI4 или AXI4-облегченные интерфейсы для скалярных или векторных портов и считать назад значения.
Образцовый проект для AXI4-потоковой генерации интерфейса
Как разработать вашу модель для AXI4-потокового вектора, или скаляр соединяют интерфейсом с генерацией
Образцовый проект для основной интерфейсной генерации AXI4
Описание Основного протокола AXI4, и как можно разработать модель для генерации ядра IP с AXI4-основными интерфейсами.
Целевые Советы FPGA программы или устройства SoC
Как программировать целевое Оборудование Intel или Xilinx
Разрешите отказы синхронизации в шаге Потока битов FPGA Сборки Рабочего процесса Генерации Ядра IP или Рабочего процесса ввода-вывода FPGA Simulink Real-Time для Находящихся в Vivado Советов.
